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PCB設(shè)計中的ESD抑止

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PCB設(shè)計中的ESD抑止

yongaixue創(chuàng)建于2011-09-08 最后編輯: 2011-09-08 09:24 3,830閱讀
PCB設(shè)計中的ESD抑止
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PCB抗ESD設(shè)計規(guī)則 7p
pdf PCB抗ESD設(shè)計規(guī)則
PCB抗ESD設(shè)計規(guī)則:ESD(靜電放電)是危害電子產(chǎn)品的潛在因素，在PCB設(shè)計中可以比較直接的避免ESD危害。本文先從ESD產(chǎn)生的機(jī)理說起，然后介紹了如何在PCB設(shè)計中通..
  • 作者: 8168533d
  • 2008-10-13
  • 格式: PDF
PCB以及ESD設(shè)計準(zhǔn)則 3p
pdf PCB以及ESD設(shè)計準(zhǔn)則
PCB以及ESD設(shè)計準(zhǔn)則
  • 作者: kge1
  • 2009-09-26
  • 格式: PDF
電子-電子基礎(chǔ)-在設(shè)計PCB時增強(qiáng)防靜電ESD功能 3p
doc 電子-電子基礎(chǔ)-在設(shè)計PCB時增強(qiáng)防靜電ESD功能
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PCB板中ESD及EMI防護(hù) 26p
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